在簡單組合邏輯電路的設(shè)計中,1.集成與非門的多余輸入端是怎么處理的?
在簡單組合邏輯電路的設(shè)計中,1.集成與非門的多余輸入端是怎么處理的?
2.通過具體的電路設(shè)計,并驗證后,你認為組合邏輯電路設(shè)計的關(guān)鍵點或關(guān)鍵步驟是什么?
2.通過具體的電路設(shè)計,并驗證后,你認為組合邏輯電路設(shè)計的關(guān)鍵點或關(guān)鍵步驟是什么?
其他人氣:196 ℃時間:2020-04-07 16:11:43
優(yōu)質(zhì)解答
與門或與非門多余輸入端要接高電平1這個事實驗報告,能不能詳細點,謝謝。只要有一個輸入端為0,與門就會輸出0,與非門輸出1,而其他輸入端無論為任何狀態(tài),都不能改變輸出了。如果現(xiàn)實的器件有多余的輸入端,只有連接高電平1,才不至于影響到結(jié)果輸出。
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