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  • VHDL 語言中 將CLK 頻率 改變 語句怎么寫process(Clk) begin if(Clk'event and Clk='1') then current_stat

    VHDL 語言中 將CLK 頻率 改變 語句怎么寫process(Clk) begin if(Clk'event and Clk='1') then current_stat
    英語人氣:655 ℃時間:2020-06-04 03:16:34
    優(yōu)質解答
    CLK頻率改變可以用計數器實現,如下current_sta就是五位的計數器,計數到“11111”就是進行64分頻,clk_s就是你需要的頻率,其值=CLK/64
    process(Clk)
    begin if(Clk'event and Clk='1') then
    if current_sta="11111" then
    clk_s
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